YuanHongbin/hc32f460_boot
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chore: 源码编码GB2312统一转换为UTF-8

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18个含有中文注释的.c/.h文件从GB2312转为UTF-8(无BOM)
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YuanHongbin
2026-07-20 14:27:38 +08:00
parent aef9d4effe
commit 8ded5ca0dc
18 changed files with 208 additions and 208 deletions
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hdl/hdl_clk.c
+29 -29
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@@ -1,11 +1,11 @@
#include "hdl_clk.h"
/********************************************************************************************************
* @函数名 hdl_xtal_init
* @描述 外部晶振初始化
* @参数 无
* @返回值 无
* @注意 无
* @鍑芥暟鍚? hdl_xtal_init
* @鎻忚堪 澶栭儴鏅舵尟鍒濆鍖?
* @鍙傛暟 鏃?
* @杩斿洖鍊? 鏃?
* @娉ㄦ剰 鏃?
********************************************************************************************************/
#if USING_XTAL
@@ -13,11 +13,11 @@ static void hdl_xtal_init(void)
{
stc_clock_xtal_init_t stcXtalInit;
/* XTAL 引脚配置 */
/* XTAL 寮曡剼閰嶇疆 */
GPIO_AnalogCmd(GPIO_PORT_H, GPIO_PIN_00 | GPIO_PIN_01, ENABLE);
(void)CLK_XtalStructInit(&stcXtalInit);
/* 配置XTAL和启用XTAL */
/* 閰嶇疆XTAL鍜屽惎鐢╔TAL */
stcXtalInit.u8State = CLK_XTAL_ON;
stcXtalInit.u8Mode = CLK_XTAL_MD_OSC;
stcXtalInit.u8Drv = CLK_XTAL_DRV_ULOW;
@@ -28,11 +28,11 @@ static void hdl_xtal_init(void)
/********************************************************************************************************
* @函数名 hdl_pll_init
* @描述 锁相环倍频初始化
* @参数 无
* @返回值 无
* @注意 无
* @鍑芥暟鍚? hdl_pll_init
* @鎻忚堪 閿佺浉鐜€嶉鍒濆鍖?
* @鍙傛暟 鏃?
* @杩斿洖鍊? 鏃?
* @娉ㄦ剰 鏃?
********************************************************************************************************/
static void hdl_pll_init(void)
{
@@ -40,7 +40,7 @@ static void hdl_pll_init(void)
(void)CLK_PLLStructInit(&stcMPLLInit);
/* MPLL 配置 */
/* MPLL 閰嶇疆 */
/* 16MHz/M*N = 16/2*50/2 = 200MHz */
stcMPLLInit.PLLCFGR = 0UL;
stcMPLLInit.PLLCFGR_f.PLLM = (2UL - 1UL);
@@ -55,33 +55,33 @@ static void hdl_pll_init(void)
/********************************************************************************************************
* @函数名 hdl_clk_init
* @描述 时钟初始化
* @参数 无
* @返回值 无
* @注意 无
* @鍑芥暟鍚? hdl_clk_init
* @鎻忚堪 鏃堕挓鍒濆鍖?
* @鍙傛暟 鏃?
* @杩斿洖鍊? 鏃?
* @娉ㄦ剰 鏃?
********************************************************************************************************/
void hdl_clk_init(void)
{
/* 解除写保护 */
/* 瑙ｉ櫎鍐欎繚鎶?*/
LL_PERIPH_WE(LL_PERIPH_EFM | LL_PERIPH_FCG | LL_PERIPH_GPIO | LL_PERIPH_PWC_CLK_RMU | LL_PERIPH_SRAM);
/* 设置时钟分频 */
/* 璁剧疆鏃堕挓鍒嗛 */
CLK_SetClockDiv(CLK_BUS_CLK_ALL, (CLK_HCLK_DIV1 | CLK_EXCLK_DIV2 | CLK_PCLK0_DIV1 | CLK_PCLK1_DIV2 | \
CLK_PCLK2_DIV4 | CLK_PCLK3_DIV4 | CLK_PCLK4_DIV2));
/* SRAM初始化包括读/写等待周期设置 */
/* SRAM鍒濆鍖栧寘鎷/鍐欑瓑寰呭懆鏈熻缃?*/
SRAM_SetWaitCycle(SRAM_SRAM_ALL, SRAM_WAIT_CYCLE1, SRAM_WAIT_CYCLE1);
SRAM_SetWaitCycle(SRAM_SRAMH, SRAM_WAIT_CYCLE0, SRAM_WAIT_CYCLE0);
/* 闪存读取等待周期设置 */
/* 闂瓨璇诲彇绛夊緟鍛ㄦ湡璁剧疆 */
EFM_SetWaitCycle(EFM_WAIT_CYCLE5);
/* XTAL 初始化 */
/* XTAL 鍒濆鍖?*/
// hdl_xtal_init();
/* XTAL32 初始化 */
/* XTAL32 鍒濆鍖?*/
/* MPLL 初始化 */
/* MPLL 鍒濆鍖?*/
hdl_pll_init();
/* enable LRC */
@@ -90,7 +90,7 @@ void hdl_clk_init(void)
/* 3 cycles for 126MHz ~ 200MHz */
GPIO_SetReadWaitCycle(GPIO_RD_WAIT3);
/* 切换驱动能力 */
/* 鍒囨崲椹卞姩鑳藉姏 */
PWC_HighSpeedToHighPerformance();
EFM_DataCacheResetCmd(ENABLE);
@@ -99,13 +99,13 @@ void hdl_clk_init(void)
/* Enable cache */
EFM_CacheCmd(ENABLE);
/* 使能写保护 */
/* 浣胯兘鍐欎繚鎶?*/
LL_PERIPH_WP(LL_PERIPH_EFM | LL_PERIPH_GPIO | LL_PERIPH_SRAM);
/* 设置系统时钟源 */
/* 璁剧疆绯荤粺鏃堕挓婧?*/
CLK_SetSysClockSrc(CLK_SYSCLK_SRC_PLL);
/* 使能systick */
/* 浣胯兘systick */
(void)SysTick_Init(1000U);
}